El tamaño de oblea de 300 mm se convirtió en la norma en el nodo de 90 nm. El tamaño de oblea anterior era de 200 mm de diámetro.
Muchas empresas (pero no todas) introdujeron la longitud de onda de 193 nm para la litografía de capas críticas, principalmente durante el nodo de 90 nm. Los problemas de rendimiento asociados con esta transición (debido al uso de nuevas fotorresistencias ) se reflejaron en los altos costos asociados con esta transición.
Desde al menos 1997, los "nodos de proceso" han recibido este nombre con fines puramente comerciales y no tienen relación con las dimensiones del circuito integrado; [1] ni la longitud de la compuerta, ni el paso del metal ni el paso de la compuerta en un dispositivo de "90 nm" son noventa nanómetros. [2] [3] [4] [5]
Toshiba, Sony y Samsung desarrollaron un proceso de 90 nm durante 2001-2002, antes de introducirlo en 2002 para la eDRAM de Toshiba y la memoria flash NAND de 2 Gb de Samsung . [7] [8] IBM demostró un proceso CMOS de silicio sobre aislante (SOI) de 90 nm , con el desarrollo dirigido por Shahidi, en 2002. El mismo año, Intel demostró un proceso de silicio deformado de 90 nm . [9] Fujitsu introdujo comercialmente su proceso de 90 nm en 2003 [10] seguido por TSMC en 2004. [11]
^ "No más nanómetros – EEJournal". 23 de julio de 2020.
^ Shukla, Priyank. "Una breve historia de la evolución de los nodos de proceso". design-reuse.com . Consultado el 9 de julio de 2019 .
^ Hruska, Joel. "14nm, 7nm, 5nm: ¿Hasta dónde puede llegar el CMOS? Depende de si le preguntas a los ingenieros o a los economistas..." ExtremeTech .
^ "Exclusivo: ¿Intel realmente está empezando a perder su liderazgo en materia de procesos? El nodo de 7 nm está previsto para su lanzamiento en 2022". wccftech.com . 10 de septiembre de 2016.
^ "La vida en 10 nm. (¿O es 7 nm?) Y 3 nm: opiniones sobre plataformas de silicio avanzadas". eejournal.com . 12 de marzo de 2018.
^ Shahidi, Ghavam G.; Antoniadis, DA; Smith, HI (diciembre de 1988). "Reducción de la corriente de sustrato generada por electrones calientes en MOSFET de silicio con longitud de canal inferior a 100 nm". IEEE Transactions on Electron Devices . 35 (12): 2430–. Bibcode :1988ITED...35.2430S. doi :10.1109/16.8835.
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^ "Tecnología de proceso CMOS de 65 nm" (PDF) . Archivado desde el original (PDF) el 16 de mayo de 2020 . Consultado el 20 de junio de 2019 .
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^ "Análisis en profundidad del Cannon Lake de 10 nm y el Core i3-8121U de Intel".
^ Presentación de Elpida en el Via Technology Forum 2005 y Informe anual de Elpida 2005
^ "EL EMOTION ENGINE® Y EL SINTETIZADOR GRÁFICO UTILIZADOS EN EL NÚCLEO DE PLAYSTATION® SE CONVIERTEN EN UN SOLO CHIP" (PDF) . Sony . 21 de abril de 2003 . Consultado el 26 de junio de 2019 .