información general | |
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Lanzado | 2017 |
Diseñado por | Tenencias de ARM |
Actuación | |
Frecuencia máxima de reloj de la CPU | 1,25 GHz [1] a 2,31 GHz [1] |
Cache | |
Caché L1 | 32–128 KB (16–64 KB de caché I con paridad, 16–64 KB de caché D) por núcleo |
Caché L2 | 64–256 KB |
Caché L3 | 512 KB – 4 MB |
Arquitectura y clasificación | |
Solicitud | Móvil |
Conjunto de instrucciones | ARMv8.2-A |
Especificaciones físicas | |
Núcleos |
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Productos, modelos, variantes | |
Nombre del código del producto |
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Historia | |
Predecesor | ARM Cortex-A53 |
Sucesor | ARM Cortex-A510 |
El ARM Cortex-A55 es una unidad central de procesamiento que implementa el conjunto de instrucciones ARMv8.2-A de 64 bits diseñado por el centro de diseño de ARM Holdings en Cambridge . El Cortex-A55 es una secuencia de decodificación superescalar en orden de 2 anchos . [2]
El Cortex-A55 es el sucesor del ARM Cortex-A53 , diseñado para mejorar el rendimiento y la eficiencia energética con respecto al A53. [3] ARM ha declarado que el A55 debería tener una eficiencia energética un 15 % mejorada y un rendimiento un 18 % mayor en relación con el A53. El acceso a la memoria y la predicción de ramificaciones también se han mejorado en relación con el A53.
Los núcleos Cortex-A75 y Cortex-A55 son los primeros productos que admiten la tecnología DynamIQ de ARM . [4] [5] Esta tecnología, sucesora de big.LITTLE , está diseñada para ser más flexible y escalable al diseñar productos de múltiples núcleos.
El Cortex-A55 está disponible como núcleo SIP para los licenciatarios, y su diseño lo hace adecuado para la integración con otros núcleos SIP (por ejemplo, GPU , controlador de pantalla , DSP , procesador de imágenes , etc.) en una sola matriz que constituye un sistema en un chip (SoC).
ARM también ha colaborado con Qualcomm para una versión semi personalizada del Cortex-A55, utilizada dentro del núcleo de CPU Kryo 385. [6] Este núcleo semi personalizado también se utiliza en algunos SoC de gama media de Qualcomm como Kryo 360 Silver y Kryo 460 Silver .